[1]徐慧 王金海 王巍.基于FPGA的8051IP核的设计与实现[J].计算机技术与发展,2009,(03):42-45.
　XU Hui,WANG Jin-hai,WANG Wei.Design and Implementation of 8051 IP Core Based on FPGA[J].,2009,(03):42-45.
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基于FPGA的8051IP核的设计与实现()
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《计算机技术与发展》[ISSN:1006-6977/CN:61-1281/TN]

卷:
期数:
2009年03期
页码:
42-45
栏目:
智能、算法、系统工程
出版日期:
1900-01-01

文章信息/Info

Title:
Design and Implementation of 8051 IP Core Based on FPGA
文章编号:
1673-629X（2009）03-0042-04
作者:
徐慧 王金海 王巍
天津工业大学信息与通信工程学院
Author(s):
XU Hui;  WANG Jin-hai; WANG Wei
School of Information and Communication Engineering,Tianjin Polytechnic University
关键词:
IP核; MCS-51微处理器; CPU核; FPGA; 可编程片上系统
Keywords:
IP core;  MCS-51 microprocessor; CPU core;  FPGA; SOPC
分类号:
TP302
文献标志码:
A
摘要:
裁减并完善了与MCS-51系列微处理器指令集完全兼容的8051IP核，减少了设计面积，提高了处理速度。按照自顶而下的设计原则，分别设计了算术逻辑单元、中心控制器、定时针数器、串行口、RAM和ROM单元。设计采用VHDL语言进行描述并鼠用ModelsimSE6.0进行功能和时序验证。将8051IP核下载到Xilinx公司的FPGA（XC3S500E-4FG320C）上进行物理验证，测试了一个LED流水灯程序，结果表明软核达到预期的效果。本设计作为可移植的IP核，可以组成片上系统，用于嵌入式系统领域。
Abstract:
Designed and reduced 8051 IP core compatible with industrial standard MCS-51 microprocessor, not only cut down the area but also increased the processing speed.Some important units such as ALU, central controller ,timer/counter, the serial port ,RAM and R

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备注/Memo

备注/Memo:
天津市自然科学基金(08JCYBJC14700)徐慧(1980-)，陕西府谷人，硕士研究生，研究方向为嵌入式系统；王金海，博士，教授，硕士生导师，研究方向为信息检测与智能处理、嵌入式系统设计与应用研究等，EMAIL ：cnwjhai@ yahcoo,com，cn，通信地址：天津工业大学信息与通信工程学院 王金海，邮编：300160。
更新日期/Last Update: 1900-01-01