[1]肖积涛 马幼鸣 周鸣争 周明龙.基于FPGA的高速数据采集系统的设计与实现[J].计算机技术与发展,2012,(06):217-220.
　XIAO Ji-tao,MA You-ming,ZHOU Ming-zheng,et al.Design of High-speed Data Acquisition System Based on FPGA[J].,2012,(06):217-220.
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基于FPGA的高速数据采集系统的设计与实现()
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《计算机技术与发展》[ISSN:1006-6977/CN:61-1281/TN]

卷:
期数:
2012年06期
页码:
217-220
栏目:
应用开发研究
出版日期:
1900-01-01

文章信息/Info

Title:
Design of High-speed Data Acquisition System Based on FPGA
文章编号:
1673-629X（2012）06-0217-04
作者:
肖积涛 马幼鸣 周鸣争 周明龙
安徽工程大学计算机与信息学院
Author(s):
XIAO Ji-tao;  MA You-ming;  ZHOU Ming-zheng;  ZHOU Ming-long
School of Computer ＆ Information, Anhui Polytechnic University
关键词:
FPGA; DDRIISDRAM; PCI总线; 数据采集系统
Keywords:
FPGA; DDRII SDRAM; PCI bus; data acquisition system
分类号:
TP39
文献标志码:
A
摘要:
为了解决高速数据采集过程中的数据量大、实时性、传输速率等问题,提出了一种基于FPGA的高速数据采集系统的实现方案。该方案以FPGA作为主控芯片,实现模拟信号通道的可控、A/D转换控制、DDRII SDRAM数据缓存、PCI总线数据的传输四个主要功能,系统采用Verilog HDL语言,通过Quartus II 6.0软件编程来实现IP核的控制,从而实现多个ADC08B200芯片进行数据采集,通过DDRII SDRAM进行数据缓存,将数据通过PCI总线传输到PC机。系统经过PC机的测试软件,能够很好地完成高速数据采集系统的任务要求
Abstract:
To solve the problem of large volumes of data, real-time, transfer rate and other issues in the high-speed data collection process, present a FPGA-based high-speed data acquisition system implementations. The project is as a master chip with FPGA,it is used to implement analog signal path control, A/D conversion control, DDRII SDRAM data cache, PCI bus transfers data four main functions. System uses the Verilog HDL language and Quartus lI 6.0 software program to achieve control of IP cores, achieving multiple ADC08B200 chip data acquisition, through the DDRII SDRAM for data caching, data transfer through the PCI bus to a PC. After the PC test system software can be a good high-speed data acquisition system to complete the task requirements

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备注/Memo

备注/Memo:
安徽省自然科学基金（KJ2007A046）肖积涛（1987-），男，江西吉安人，硕士研究生，研究方向为计算机控制与嵌入式系统马幼鸣，副教授，研究方向为嵌入式系统
更新日期/Last Update: 1900-01-01