[1]房瑞华 黄士坦.用STATECAD快速设计有限状态机[J].计算机技术与发展,2006,(12):122-123.
　FANG Rui-hua,HUANG Shi-tan.Repid Design of Finite State Machine with STATECAD[J].,2006,(12):122-123.
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用STATECAD快速设计有限状态机()
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《计算机技术与发展》[ISSN:1006-6977/CN:61-1281/TN]

卷:
期数:
2006年12期
页码:
122-123
栏目:
智能、算法、系统工程
出版日期:
1900-01-01

文章信息/Info

Title:
Repid Design of Finite State Machine with STATECAD
文章编号:
1673-629X（2006）12-0122-02
作者:
房瑞华 黄士坦
西安微电子技术研究所
Author(s):
FANG Rui-hua; HUANG Shi-tan
Xi＇ an Microelectronic Technology Institute
关键词:
有限状态机; SrATECAD; VHDL
Keywords:
finite state machine;  STATECAD;  VHDL
分类号:
TP18
文献标志码:
A
摘要:
有限状态机设计的关键是如何把一个实际的时序逻辑关系抽象成一个时序逻辑函数，传统的电路图输入法通过直接设计寄存器组来实现各个状态之间的转换，而用硬件描述语言来描述有限状态机，往往是通过充分发挥硬件描述语言的抽象建模能力，通过对系统在系统级或寄存器传输级进行描述来建立有限状态机。随着EDA工具的快速发展，通过CAD快速设计有限状态机自动化成为可能
Abstract:
The key to design finite state machine is how to abstract a sequence logic function from a real sequence logic relationship. The traditional way of input circuit diagram to realize transition of state via designing register set directly. However, describe finite state machine with hardware description language aways by fully using ability of abstract model and describing system level or register transfer level. With the rapid development of EDA tools,rapid design finite state machine automation with CAD will come true

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备注/Memo

备注/Memo:
房瑞华（1977-），女，陕西临潼人，硕士研究生，研究方向为计算机系统结构；黄士坦，研究员，博士生导师，主要研究方向为计算机系统结构
更新日期/Last Update: 1900-01-01